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1. BRAM_DDR3_HDMI BRAM_DDR3_HDMI Public

   在FPGA中将图像数据输入到DDR3中，再输送到HDMI接口上进行显示。

   VHDL 21 6

2. ZYNQ_PL_CONV_ACC ZYNQ_PL_CONV_ACC Public

   一个基于AXI接口的PL端卷积加速器，可由PS端调用

   VHDL 9

3. BRAM_HDMI_TEST BRAM_HDMI_TEST Public

   将数据从FPGA的BRAM输出到HDMI接口的测试例程

   VHDL 5

4. Vivado_FIFO_Test Vivado_FIFO_Test Public

   用于测试Vivado提供的FIFO IP核不同配置的时序与逻辑，以供设计参考

   VHDL 3

5. Ethernet_DDR3_HDMI Ethernet_DDR3_HDMI Public

   将图像数据从以太网传输到DDR3，再传输到HDMI进行显示的vivado例程

   VHDL 3 2

6. ZYNQ_PLPS_LOOP ZYNQ_PLPS_LOOP Public

   在ZYNQ中设计了自定义的PL端数据处理器，通过DMA连接到AXI总线，完成了PS和该PL端的数据交互等功能。

   VHDL 3